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陈小湾
求职意向
工作经历
XXX电子是专注于工业控制与通信领域的嵌入式系统方案提供商，团队规模约XXX人，核心业务为高速数据采集卡与协议转换设备的研发与生产，产品服务于超过XXX家工业自动化与通信设备制造商，与多家行业客户建立了稳定的供应链关系。
工作概述：
1.代码开发：依据功能需求文档，使用Verilog HDL进行FPGA逻辑代码编写；主要负责通信接口与控制状态机等模块的开发，配合仿真测试验证功能正确性；通过代码审查优化冗余逻辑，将指定模块的资源使用率降低XXX%。
2.模块仿真：负责编写Testbench对自主开发的模块进行功能仿真；使用ModelSim工具观察波形，定位并修复设计中存在的时序与逻辑错误；建立模块级仿真用例库，将单个模块的平均验证周期缩短XXX小时。
3.设计实现：负责将通过的代码进行综合与布局布线；配置时钟、引脚约束文件，分析时序报告并对关键路径进行优化；解决布局布线后的时序违例问题，使最终设计的时序余量达到XXX ns。
4.文档协作：根据公司规范编写模块设计文档与测试报告；使用Git进行版本管理，协同硬件工程师完成板级调试的问题记录与追踪；通过文档标准化，将设计移交至后续环节的沟通成本降低XXX%。
工作业绩：
1.独立完成X个关键功能模块的代码开发与仿真验证，功能一次通过率达到XXX%。
2.建立并维护包含XXX个测试用例的模块仿真库，支撑团队后续项目的复用。
3.参与X款产品的FPGA设计实现环节，所有设计均满足板级调试的时序要求。
4.产出设计文档与报告XXX份，保障了团队内部及跨部门协作的信息同步。
主动离职，希望有更多的工作挑战和涨薪机会。
项目经历
公司为某工业设备厂商定制的网关项目，原有方案采用通用处理器处理多种现场总线协议，存在实时性差与CPU负载过高的问题，在同时处理Modbus TCP与XXX总线协议时，报文转发延迟高达X ms，无法满足客户对XXX个节点同步控制的需求，需通过FPGA实现协议硬件解析以释放主处理器资源。
项目职责：
1.功能设计：负责Modbus TCP协议解析硬件的逻辑设计，根据协议规范定义帧头检测、CRC校验与数据提取等子模块。
2.仿真验证：搭建模块级仿真环境，编写定向与随机测试用例，验证模块在不同报文长度与错误帧情况下的行为是否符合预期。
3.板级调试：协助硬件工程师进行上板测试，使用ILA工具抓取内部信号，定位并解决了因异步时钟域导致的少量数据丢失问题。
4.测试支持：编写模块的集成测试用例，配合系统联调，记录测试数据并输出模块测试报告。
项目业绩：
1.成功实现Modbus TCP协议硬件解析模块，将协议处理延迟从X ms降低至Y us。
2.通过充分的仿真验证，模块在系统集成测试中一次通过，缺陷数少于X个。
3.该模块帮助主处理器负载降低XXX%，保障了网关支持XXX个节点稳定通信。
4.形成的设计文档与测试用例被收录为团队知识库，支持了后续X个类似项目。
教育背景
GPA X.XX/X.X（专业前XX%），主修数字电路、信号与系统等核心课程，熟练掌握Verilog硬件描述语言与Vivado开发工具。参与基于FPGA的数字示波器课程设计，在团队中负责触发控制与数据缓存模块开发，完成XX MHz采样率的波形显示功能。
自我评价
培训经历
系统学习了FPGA高级设计方法与时序分析理论。将培训所学的时序约束与优化方法应用于实际项目，解决了关键路径时序违例问题，使目标模块最高运行频率提升XXX%，并总结出团队内部的设计检查清单。
应届生FPGA开发经典简历模板
733人使用适用人群: #FPGA开发 #应届生[<1年]
[基本信息]
姓名：陈小湾
性别：男
年龄：26
学历：本科
婚姻：未婚
年限：4年
面貌：党员
邮箱：xiaowan@gangwan.com
电话：18600001654
[求职意向]
工作性质：全职
应聘职位：FPGA开发
期望城市：北京
期望薪资：8000-10000
求职状态：离职-随时到岗
[工作经历]
北京XX科技有限公司 | FPGA开发
2024-09 - 2025-12
XXX电子是专注于工业控制与通信领域的嵌入式系统方案提供商，团队规模约XXX人，核心业务为高速数据采集卡与协议转换设备的研发与生产，产品服务于超过XXX家工业自动化与通信设备制造商，与多家行业客户建立了稳定的供应链关系。
工作概述：
1.代码开发：依据功能需求文档，使用Verilog HDL进行FPGA逻辑代码编写；主要负责通信接口与控制状态机等模块的开发，配合仿真测试验证功能正确性；通过代码审查优化冗余逻辑，将指定模块的资源使用率降低XXX%。
2.模块仿真：负责编写Testbench对自主开发的模块进行功能仿真；使用ModelSim工具观察波形，定位并修复设计中存在的时序与逻辑错误；建立模块级仿真用例库，将单个模块的平均验证周期缩短XXX小时。
3.设计实现：负责将通过的代码进行综合与布局布线；配置时钟、引脚约束文件，分析时序报告并对关键路径进行优化；解决布局布线后的时序违例问题，使最终设计的时序余量达到XXX ns。
4.文档协作：根据公司规范编写模块设计文档与测试报告；使用Git进行版本管理，协同硬件工程师完成板级调试的问题记录与追踪；通过文档标准化，将设计移交至后续环节的沟通成本降低XXX%。
工作业绩：
1.独立完成X个关键功能模块的代码开发与仿真验证，功能一次通过率达到XXX%。
2.建立并维护包含XXX个测试用例的模块仿真库，支撑团队后续项目的复用。
3.参与X款产品的FPGA设计实现环节，所有设计均满足板级调试的时序要求。
4.产出设计文档与报告XXX份，保障了团队内部及跨部门协作的信息同步。
[项目经历]
项目名称：基于FPGA的工业通信网关协议转换模块
担任角色：项目负责人
公司为某工业设备厂商定制的网关项目，原有方案采用通用处理器处理多种现场总线协议，存在实时性差与CPU负载过高的问题，在同时处理Modbus TCP与XXX总线协议时，报文转发延迟高达X ms，无法满足客户对XXX个节点同步控制的需求，需通过FPGA实现协议硬件解析以释放主处理器资源。
项目业绩：
1.成功实现Modbus TCP协议硬件解析模块，将协议处理延迟从X ms降低至Y us。
2.通过充分的仿真验证，模块在系统集成测试中一次通过，缺陷数少于X个。
3.该模块帮助主处理器负载降低XXX%，保障了网关支持XXX个节点稳定通信。
4.形成的设计文档与测试用例被收录为团队知识库，支持了后续X个类似项目。
[教育背景]
哈尔滨理工大学
电子信息工程 | 本科
GPA X.XX/X.X（专业前XX%），主修数字电路、信号与系统等核心课程，熟练掌握Verilog硬件描述语言与Vivado开发工具。参与基于FPGA的数字示波器课程设计，在团队中负责触发控制与数据缓存模块开发，完成XX MHz采样率的波形显示功能。