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陈小湾
求职意向
工作经历
XXX半导体有限公司是专注电源管理芯片（PMIC）设计的Fabless公司，团队规模约XXX人，核心产品为应用于手机、平板等消费电子的多模电源转换芯片，已成功量产XXX颗芯片，与多家国内主流封装测试厂建立稳定合作。
工作概述：
1.版图设计：依据电路工程师提供的晶体管级原理图与设计需求，进行整体模块布局规划；主导完成LDO、Bandgap、Charge Pump等模拟模块的版图绘制，重点处理匹配、对称及电流走向问题；与电路工程师紧密沟通，根据仿真反馈进行多次迭代优化，累计支持XXX个芯片项目的版图设计任务，单模块最大设计面积达XXX平方毫米。
2.验证优化：负责设计完成后的物理验证与电气规则检查；使用Calibre工具执行DRC、LVS检查，识别并修正连接性错误、天线效应及密度违例；通过编写部分验证规则脚本，优化检查流程，将平均验证周期缩短XXX%，累计发现并修正各类错误超过XXX个，保障设计数据准确交付。
3.寄生分析：在版图设计阶段考虑后仿精度要求，主导寄生参数提取（PEX）流程；使用QRC工具提取关键路径的寄生电阻电容，生成后仿网表交付电路团队进行仿真验证；针对时钟路径等敏感模块优化版图布线，将关键路径的寄生电容预估偏差控制在XXX%以内。
4.数据交付：整理并归档最终版图的GDSII数据文件、设计文档及验证报告；按照Foundry的工艺设计套件（PDK）要求，准备完整的tape-out数据包；与后端团队及封装厂对接，提供版图相关的信息支持，确保XXX次流片数据交付零失误。
5.工艺支持：跟进XXXnm至XXXnm等不同工艺节点的设计规则差异；参与新工艺平台PDK的评估与导入，测试关键器件的版图设计规则；针对工艺偏移问题，在版图中加入必要的工艺监控结构（PCM），为芯片量产后的良率分析提供基础。
6.文档沉淀：整理常用模拟模块的版图设计检查清单与最佳实践文档；主导建立部门内部的版图设计复用库，收录经过验证的LDO、OSC等模块版图；通过组织内部分享，将新员工独立上手周期平均缩短了XXX天。
工作业绩：
1.主导并完成XXX个模拟模块的版图设计与验证，支持公司XXX款主力电源芯片成功流片并量产。
2.通过验证流程优化与脚本辅助，将单模块平均验证时间缩短XXX%，整体设计迭代效率提升XXX%。
3.负责交付的版图数据包准确率XXX%，保障所有负责项目均一次性通过Foundry的物理验证。
4.建立的版图设计复用库包含XXX个已验证模块，被后续项目引用超过XXX次，显著减少重复设计工作量。
主动离职，希望有更多的工作挑战和涨薪机会。
项目经历
公司首款用于数据通信的Serializer/Deserializer芯片研发项目，TX模块包含高速串行器、时钟数据恢复电路及预驱动器，设计于XXXnm CMOS工艺，工作速率达XXX Gbps。版图设计面临严格的信号完整性挑战，需解决数模混合干扰、电源噪声隔离及长走线延时匹配等问题，同时满足紧凑的面积预算以控制成本。
项目职责：
1.负责TX模块中PLL、高速串行器等关键模拟子电路的版图布局与绘制，采用保护环、深N阱隔离等技术抑制衬底噪声耦合。
2.执行全模块的DRC/LVS物理验证与天线效应检查，并针对高速差分走线进行专项的寄生参数提取与后仿支持。
3.主导数模混合布局的规划，与数字后端团队协同确定电源域划分与隔离带设置，优化整体电源分布网络。
4.整理项目中的版图设计约束、验证报告及问题记录，形成该工艺节点下高速接口版图的设计指南。
项目业绩：
1.按时交付符合设计规格的版图，芯片流片后测试显示TX模块功能一次性通过，工作速率达到XXX Gbps目标。
2.通过精心的布局规划与布线优化，在满足所有性能指标的前提下，版图面积比初始预估节省了XXX%。
3.输出的设计指南被后续XXX个高速接口类芯片项目采纳，作为版图设计的标准参考依据。
教育背景
GPA XXX，排名专业前XXX%，主修模拟集成电路设计、半导体物理与器件、集成电路工艺等核心课程。熟练掌握Cadence Virtuoso、Synopsys Custom Compiler版图设计工具及Calibre验证工具。课程设计完成带隙基准电压源（Bandgap Reference）的电路设计与版图实现，独立完成DRC/LVS验证并撰写设计报告。
自我评价
培训经历
系统学习了先进工艺节点下的版图设计方法与Cadence工具链深度应用。将认证所学的匹配性设计、可靠性增强等技巧应用于多个量产项目，在LDO模块版图中通过优化器件布局与连线，使其在工艺角波动下的性能稳定性提升。输出的高速差分对版图设计规范成为团队内部标准，助力新项目验证通过率提升XXX%。
中级模拟版图设计工程师实用简历模板
591人使用适用人群: #模拟版图设计工程师 #中级[3-5年]
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[基本信息]
姓名：陈小湾
性别：男
年龄：26
学历：本科
婚姻：未婚
年限：4年
面貌：党员
邮箱：xiaowan@gangwan.com
电话：18600001654
[求职意向]
工作性质：全职
应聘职位：模拟版图设计工程师
期望城市：北京
期望薪资：8000-10000
求职状态：离职-随时到岗
[工作经历]
北京XX科技有限公司 | 模拟版图设计工程师
2024-09 - 2025-12
XXX半导体有限公司是专注电源管理芯片（PMIC）设计的Fabless公司，团队规模约XXX人，核心产品为应用于手机、平板等消费电子的多模电源转换芯片，已成功量产XXX颗芯片，与多家国内主流封装测试厂建立稳定合作。
工作概述：
1.版图设计：依据电路工程师提供的晶体管级原理图与设计需求，进行整体模块布局规划；主导完成LDO、Bandgap、Charge Pump等模拟模块的版图绘制，重点处理匹配、对称及电流走向问题；与电路工程师紧密沟通，根据仿真反馈进行多次迭代优化，累计支持XXX个芯片项目的版图设计任务，单模块最大设计面积达XXX平方毫米。
2.验证优化：负责设计完成后的物理验证与电气规则检查；使用Calibre工具执行DRC、LVS检查，识别并修正连接性错误、天线效应及密度违例；通过编写部分验证规则脚本，优化检查流程，将平均验证周期缩短XXX%，累计发现并修正各类错误超过XXX个，保障设计数据准确交付。
3.寄生分析：在版图设计阶段考虑后仿精度要求，主导寄生参数提取（PEX）流程；使用QRC工具提取关键路径的寄生电阻电容，生成后仿网表交付电路团队进行仿真验证；针对时钟路径等敏感模块优化版图布线，将关键路径的寄生电容预估偏差控制在XXX%以内。
4.数据交付：整理并归档最终版图的GDSII数据文件、设计文档及验证报告；按照Foundry的工艺设计套件（PDK）要求，准备完整的tape-out数据包；与后端团队及封装厂对接，提供版图相关的信息支持，确保XXX次流片数据交付零失误。
5.工艺支持：跟进XXXnm至XXXnm等不同工艺节点的设计规则差异；参与新工艺平台PDK的评估与导入，测试关键器件的版图设计规则；针对工艺偏移问题，在版图中加入必要的工艺监控结构（PCM），为芯片量产后的良率分析提供基础。
6.文档沉淀：整理常用模拟模块的版图设计检查清单与最佳实践文档；主导建立部门内部的版图设计复用库，收录经过验证的LDO、OSC等模块版图；通过组织内部分享，将新员工独立上手周期平均缩短了XXX天。
工作业绩：
1.主导并完成XXX个模拟模块的版图设计与验证，支持公司XXX款主力电源芯片成功流片并量产。
2.通过验证流程优化与脚本辅助，将单模块平均验证时间缩短XXX%，整体设计迭代效率提升XXX%。
3.负责交付的版图数据包准确率XXX%，保障所有负责项目均一次性通过Foundry的物理验证。
4.建立的版图设计复用库包含XXX个已验证模块，被后续项目引用超过XXX次，显著减少重复设计工作量。
[项目经历]
项目名称：高速SerDes TX模块版图设计
担任角色：项目负责人
公司首款用于数据通信的Serializer/Deserializer芯片研发项目，TX模块包含高速串行器、时钟数据恢复电路及预驱动器，设计于XXXnm CMOS工艺，工作速率达XXX Gbps。版图设计面临严格的信号完整性挑战，需解决数模混合干扰、电源噪声隔离及长走线延时匹配等问题，同时满足紧凑的面积预算以控制成本。
项目业绩：
1.按时交付符合设计规格的版图，芯片流片后测试显示TX模块功能一次性通过，工作速率达到XXX Gbps目标。
2.通过精心的布局规划与布线优化，在满足所有性能指标的前提下，版图面积比初始预估节省了XXX%。
3.输出的设计指南被后续XXX个高速接口类芯片项目采纳，作为版图设计的标准参考依据。
[教育背景]
杭州电子科技大学
微电子科学与工程 | 本科
GPA XXX，排名专业前XXX%，主修模拟集成电路设计、半导体物理与器件、集成电路工艺等核心课程。熟练掌握Cadence Virtuoso、Synopsys Custom Compiler版图设计工具及Calibre验证工具。课程设计完成带隙基准电压源（Bandgap Reference）的电路设计与版图实现，独立完成DRC/LVS验证并撰写设计报告。