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陈小湾
求职意向
工作经历
XXX半导体是一家专注于高性能计算和物联网芯片设计的公司，团队规模约XXX人，核心业务是面向数据中心和边缘设备的ASIC/SoC芯片设计服务，产品已成功流片并量产交付超过XXX颗，与多家国内系统厂商建立长期合作。
工作概述：
1.架构定义：参与SoC芯片的规格制定和前端架构定义，根据系统需求和功耗面积目标进行方案评估；与算法和软件团队协同，分析关键路径并制定微架构文档；通过建立仿真模型进行性能评估，最终方案将计算单元的能效比提升XXX%。
2.模块设计：负责CPU/NPU子系统或高速接口模块的RTL设计；基于架构文档拆分功能点，使用Verilog/SystemVerilog完成电路描述；搭建模块级验证环境进行基础功能测试，确保RTL代码与规格一致，设计交付质量达标，模块首轮验证通过率提升至XXX%。
3.验证计划：制定模块和子系统的详细验证计划，分解测试点并明确覆盖目标；编写直接测试用例和随机约束，利用UVM方法学搭建可重用测试平台；跟踪覆盖率收敛情况，分析未覆盖点并补充定向测试，确保验证完备性，将后期集成阶段发现的模块级问题数量降低XXX%。
4.代码质量：建立并维护RTL代码的质量检查流程，在签入前进行代码风格和综合友好性检查；通过lint工具和CDC检查工具提前识别潜在问题；组织代码审查，推动团队遵守编码规范，使得综合后时序违例减少XXX%，团队代码风格一致性显著提升。
5.低功耗设计：在RTL级实现功耗优化，采用时钟门控、电源门控和多电压域设计；编写UPF文件定义电源意图，并与验证团队协同进行低功耗验证；分析动态和静态功耗报告，优化电路结构，在满足性能前提下将目标模块的待机功耗降低XXX%。
6.时序收敛：负责模块级综合与时序分析，根据物理团队反馈的线负载模型制定时序约束；分析关键路径并进行RTL级优化，如逻辑重组和流水线插入；与后端工程师紧密协作，确保模块满足目标频率，将模块交付时的建立时间违例路径数量减少XXX%。
7.团队协作：指导初级工程师完成模块设计和验证任务，解答技术问题并分享经验；负责技术文档的撰写与维护，包括设计文档和接口文档；参与项目里程碑评审，提出风险预警和优化建议，帮助团队新成员平均上手时间缩短XXX%。
工作业绩：
1.主导完成X款量产芯片中关键数字前端模块的设计与交付，芯片均成功流片并达到性能目标。
2.构建的模块级验证环境与用例被复用至后续X个类似项目，验证周期平均缩短XXX%。
3.推行的代码质量流程使团队综合后时序收敛效率提升XXX%，减少了迭代次数。
4.通过低功耗设计方案，助力芯片在竞标中胜出，为某边缘计算产品节省功耗XXX%。
5.指导并培养X名初级工程师成长为能独立负责模块设计的技术骨干。
主动离职，希望有更多的工作挑战和涨薪机会。
项目经历
公司战略级项目，旨在设计一款面向数据中心的高能效AI推理芯片，支持主流深度学习框架。项目面临挑战：处理核心需要实现高达XXX TOPS的算力，同时功耗预算严格；多核间数据一致性协议复杂，仿真速度慢；芯片规模大，门级网表仿真耗时长达数天，严重拖累验证进度。
项目职责：
1.核心模块设计：负责芯片中张量处理单元(TPU)的微架构设计与RTL实现，设计支持多种数据位宽的并行计算阵列和片上缓存体系。
2.系统集成与验证：集成自研IP与第三方接口IP，构建子系统级验证环境，编写复杂场景的测试用例以验证多核协同与数据一致性。
3.性能与功耗优化：通过架构折衷与RTL级优化，如设计细粒度时钟门控和优化数据搬运路径，在满足时序的前提下平衡性能与功耗。
4.前端流程支持：为综合与后端团队提供清晰约束与文档，协助分析时序违例和功耗报告，完成RTL到门级网表的交付。
5.问题调试：主导芯片级仿真和FPGA原型验证中发现的复杂硬件问题调试，定位根因并提供设计修复方案。
项目业绩：
1.主导的TPU核心设计达到目标算力XXX TOPS，能效比超出竞品分析目标XXX%。
2.搭建的系统级验证平台提前发现并修复了XXX个深度隐藏缺陷，芯片一次流片成功。
3.通过前端设计优化，使芯片在典型工作负载下的功耗降低XXX%，达到客户散热要求。
4.优化的验证方法与仿真脚本，将门级网表的关键功能仿真周期从XXX天缩短至XXX天。
教育背景
GPA X.XX/X.X（专业前XX%），主修数字电路设计、微电子学与计算机体系结构核心课程，参与基于FPGA的图像处理系统课程设计，在团队中负责图像算法硬件加速模块开发，完成从算法移植到板级调试全流程，熟悉Verilog编程与Modelsim仿真工具，掌握数字集成电路前端设计基础流程。
自我评价
培训经历
系统学习了先进工艺节点下的数字前端设计方法学，将系统级功耗分析与优化技术应用于实际项目，通过实施微架构改进与RTL级功耗优化，使负责模块的动态功耗降低约XXX%，相关设计报告成为团队内部参考范例。
资深数字前端设计师现代简历模板
261人使用适用人群: #数字前端设计师 #资深[10+年]
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[基本信息]
姓名：陈小湾
性别：男
年龄：26
学历：本科
婚姻：未婚
年限：4年
面貌：党员
邮箱：xiaowan@gangwan.com
电话：18600001654
[求职意向]
工作性质：全职
应聘职位：数字前端设计师
期望城市：北京
期望薪资：8000-10000
求职状态：离职-随时到岗
[工作经历]
北京XX科技有限公司 | 数字前端设计师
2024-09 - 2025-12
XXX半导体是一家专注于高性能计算和物联网芯片设计的公司，团队规模约XXX人，核心业务是面向数据中心和边缘设备的ASIC/SoC芯片设计服务，产品已成功流片并量产交付超过XXX颗，与多家国内系统厂商建立长期合作。
工作概述：
1.架构定义：参与SoC芯片的规格制定和前端架构定义，根据系统需求和功耗面积目标进行方案评估；与算法和软件团队协同，分析关键路径并制定微架构文档；通过建立仿真模型进行性能评估，最终方案将计算单元的能效比提升XXX%。
2.模块设计：负责CPU/NPU子系统或高速接口模块的RTL设计；基于架构文档拆分功能点，使用Verilog/SystemVerilog完成电路描述；搭建模块级验证环境进行基础功能测试，确保RTL代码与规格一致，设计交付质量达标，模块首轮验证通过率提升至XXX%。
3.验证计划：制定模块和子系统的详细验证计划，分解测试点并明确覆盖目标；编写直接测试用例和随机约束，利用UVM方法学搭建可重用测试平台；跟踪覆盖率收敛情况，分析未覆盖点并补充定向测试，确保验证完备性，将后期集成阶段发现的模块级问题数量降低XXX%。
4.代码质量：建立并维护RTL代码的质量检查流程，在签入前进行代码风格和综合友好性检查；通过lint工具和CDC检查工具提前识别潜在问题；组织代码审查，推动团队遵守编码规范，使得综合后时序违例减少XXX%，团队代码风格一致性显著提升。
5.低功耗设计：在RTL级实现功耗优化，采用时钟门控、电源门控和多电压域设计；编写UPF文件定义电源意图，并与验证团队协同进行低功耗验证；分析动态和静态功耗报告，优化电路结构，在满足性能前提下将目标模块的待机功耗降低XXX%。
6.时序收敛：负责模块级综合与时序分析，根据物理团队反馈的线负载模型制定时序约束；分析关键路径并进行RTL级优化，如逻辑重组和流水线插入；与后端工程师紧密协作，确保模块满足目标频率，将模块交付时的建立时间违例路径数量减少XXX%。
7.团队协作：指导初级工程师完成模块设计和验证任务，解答技术问题并分享经验；负责技术文档的撰写与维护，包括设计文档和接口文档；参与项目里程碑评审，提出风险预警和优化建议，帮助团队新成员平均上手时间缩短XXX%。
工作业绩：
1.主导完成X款量产芯片中关键数字前端模块的设计与交付，芯片均成功流片并达到性能目标。
2.构建的模块级验证环境与用例被复用至后续X个类似项目，验证周期平均缩短XXX%。
3.推行的代码质量流程使团队综合后时序收敛效率提升XXX%，减少了迭代次数。
4.通过低功耗设计方案，助力芯片在竞标中胜出，为某边缘计算产品节省功耗XXX%。
5.指导并培养X名初级工程师成长为能独立负责模块设计的技术骨干。
[项目经历]
项目名称：云端AI推理芯片设计
担任角色：项目负责人
公司战略级项目，旨在设计一款面向数据中心的高能效AI推理芯片，支持主流深度学习框架。项目面临挑战：处理核心需要实现高达XXX TOPS的算力，同时功耗预算严格；多核间数据一致性协议复杂，仿真速度慢；芯片规模大，门级网表仿真耗时长达数天，严重拖累验证进度。
项目业绩：
1.主导的TPU核心设计达到目标算力XXX TOPS，能效比超出竞品分析目标XXX%。
2.搭建的系统级验证平台提前发现并修复了XXX个深度隐藏缺陷，芯片一次流片成功。
3.通过前端设计优化，使芯片在典型工作负载下的功耗降低XXX%，达到客户散热要求。
4.优化的验证方法与仿真脚本，将门级网表的关键功能仿真周期从XXX天缩短至XXX天。
[教育背景]
合肥工业大学
电子信息工程 | 本科
GPA X.XX/X.X（专业前XX%），主修数字电路设计、微电子学与计算机体系结构核心课程，参与基于FPGA的图像处理系统课程设计，在团队中负责图像算法硬件加速模块开发，完成从算法移植到板级调试全流程，熟悉Verilog编程与Modelsim仿真工具，掌握数字集成电路前端设计基础流程。