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陈小湾

性别: 男 年龄: 26 学历: 本科 婚姻状态: 未婚 工作年限: 4年 政治面貌: 党员 邮箱: xiaowan@gangwan.com 电话号码: 18600001654

求职意向

工作性质: 全职 应聘职位: 数字前端设计师 期望工作地址: 北京 期望薪资: 8000-10000 求职状态: 离职-随时到岗

工作经历

2024-09 - 2025-12
北京XX科技有限公司
北京

XX集成电路是一家专注通信与物联网领域芯片设计的公司,团队规模约XXX人,核心产品为低功耗MCU与无线通信芯片,已服务超过XXX家下游方案商,与多家智能硬件品牌建立芯片供应合作。

数字前端设计师 汇报对象:部门总监

工作概述:

1.RTL设计:根据模块规格书进行数字电路代码编写,使用Verilog语言实现特定功能;配合架构师理解算法需求,将控制逻辑和数据通路转化为寄存器传输级描述;完成初步功能仿真,保障代码行为与预期一致,模块首次仿真通过率提升XXX%。

2.模块验证:搭建模块级测试平台,编写定向测试用例和随机约束测试;使用仿真工具追踪波形,定位并修复设计中存在的功能缺陷;与设计工程师协同调试,将验证收敛周期缩短XXX天。

3.交付支持:生成模块的综合脚本与相关交付文档,检查代码风格与命名规范;参与设计评审,记录会议要点并跟进问题修改;协助后端工程师完成初步时序检查,保障交付件质量,交付问题单数量减少XXX%。

4.流程优化:整理日常仿真与调试中的常见问题,参与编写团队内部设计checklist;学习并使用脚本语言自动化部分重复性文件检查工作,将人工检查时间平均减少XXX分钟。


工作业绩:

1.独立完成X个MCU外设控制模块的RTL设计与交付,代码通过lint检查与CDC检查。

2.参与X个模块的验证与调试工作,累计发现并协助修复XXX个功能缺陷。

3.支持X次项目流片前的设计交付,所有负责模块均按时完成且无重大交付问题。

4.输出X份设计辅助文档与脚本,被团队采纳并应用,提升协同效率。

主动离职,希望有更多的工作挑战和涨薪机会。

项目经历

2024-09 - 2025-12
低功耗MCU芯片数字前端设计
项目负责人

公司面向物联网传感器节点的主打芯片项目,需在满足XXXuA级睡眠功耗的前提下,集成多种外设接口与硬件加速器。原有设计在多个电源域切换时存在控制信号不同步风险,异步FIFO深度设计余量不足导致数据丢失,模块间握手协议不一致影响集成效率,整体设计面积需控制在XX mm²以内以降低芯片成本。

项目职责:

1.功能开发:负责SPI主机控制器与看门狗定时器模块的RTL设计,依据协议标准实现全双工通信与可编程超时复位功能。

2.模块验证:搭建控制器模块的UVM验证环境,编写接口序列与功能覆盖率模型,完成模块级验证与系统级联调。

3.交付支持:生成模块的综合脚本与时序约束文件,编写设计说明书与集成指南,支持后端物理实现。

4.协同调试:参与芯片顶层集成的网表仿真,协助定位跨时钟域信号问题,修改设计代码以消除亚稳态风险。

项目业绩:

1.负责模块一次流片成功,功能测试通过率达XXX%,满足芯片低功耗与面积指标。

2.模块验证覆盖率达成XXX%,累计发现并修复设计问题XX个,有效降低流片风险。

3.项目按时完成Tape-out,芯片量产良率超过XX%,已应用于XXX家客户的终端产品中。

教育背景

2020-09 - 2024-07
西安电子科技大学
微电子科学与工程 本科

GPA X.XX/X.X(专业前XX%),主修数字集成电路设计、硬件描述语言与计算机体系结构核心课程,完成基于FPGA的图像采集系统课程设计,在项目中负责SDRAM控制器模块的Verilog编码与仿真测试,熟悉VCS仿真工具与Linux开发环境,掌握数字电路前端设计基本流程。

自我评价

专业背景:具备扎实的数字电路理论基础与项目实践,熟悉芯片数字前端从设计到交付的全流程,掌握Verilog、UVM、Linux等基本技能。技术落地:成功将课程所学应用于实际芯片模块开发,独立完成外设控制器设计并通过验证,保障了项目节点的按时交付。职业素养:工作严谨细致,能快速理解设计需求并执行,具有良好的团队协作意识与文档编写习惯,致力于在项目中持续积累与成长。

培训经历

2024-09 - 2025-12
岗湾培训中心
集成电路验证工程师认证 北京

系统学习UVM方法学与高级验证技术,将验证平台构建与覆盖率驱动验证方法应用于MCU项目,参与搭建模块级UVM环境,提升了测试场景的完备性与验证效率。

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姓名:陈小湾

性别:

年龄:26

学历:本科

婚姻:未婚

年限:4年

面貌:党员

邮箱:xiaowan@gangwan.com

电话:18600001654

工作性质:全职

应聘职位:数字前端设计师

期望城市:北京

期望薪资:8000-10000

求职状态:离职-随时到岗

北京XX科技有限公司 | 数字前端设计师

2024-09 - 2025-12

公司背景:

XX集成电路是一家专注通信与物联网领域芯片设计的公司,团队规模约XXX人,核心产品为低功耗MCU与无线通信芯片,已服务超过XXX家下游方案商,与多家智能硬件品牌建立芯片供应合作。

工作内容:

工作概述:

1.RTL设计:根据模块规格书进行数字电路代码编写,使用Verilog语言实现特定功能;配合架构师理解算法需求,将控制逻辑和数据通路转化为寄存器传输级描述;完成初步功能仿真,保障代码行为与预期一致,模块首次仿真通过率提升XXX%。

2.模块验证:搭建模块级测试平台,编写定向测试用例和随机约束测试;使用仿真工具追踪波形,定位并修复设计中存在的功能缺陷;与设计工程师协同调试,将验证收敛周期缩短XXX天。

3.交付支持:生成模块的综合脚本与相关交付文档,检查代码风格与命名规范;参与设计评审,记录会议要点并跟进问题修改;协助后端工程师完成初步时序检查,保障交付件质量,交付问题单数量减少XXX%。

4.流程优化:整理日常仿真与调试中的常见问题,参与编写团队内部设计checklist;学习并使用脚本语言自动化部分重复性文件检查工作,将人工检查时间平均减少XXX分钟。


工作业绩:

1.独立完成X个MCU外设控制模块的RTL设计与交付,代码通过lint检查与CDC检查。

2.参与X个模块的验证与调试工作,累计发现并协助修复XXX个功能缺陷。

3.支持X次项目流片前的设计交付,所有负责模块均按时完成且无重大交付问题。

4.输出X份设计辅助文档与脚本,被团队采纳并应用,提升协同效率。

项目名称:低功耗MCU芯片数字前端设计

担任角色:项目负责人

项目背景:
项目内容:

公司面向物联网传感器节点的主打芯片项目,需在满足XXXuA级睡眠功耗的前提下,集成多种外设接口与硬件加速器。原有设计在多个电源域切换时存在控制信号不同步风险,异步FIFO深度设计余量不足导致数据丢失,模块间握手协议不一致影响集成效率,整体设计面积需控制在XX mm²以内以降低芯片成本。

项目业绩:

项目业绩:

1.负责模块一次流片成功,功能测试通过率达XXX%,满足芯片低功耗与面积指标。

2.模块验证覆盖率达成XXX%,累计发现并修复设计问题XX个,有效降低流片风险。

3.项目按时完成Tape-out,芯片量产良率超过XX%,已应用于XXX家客户的终端产品中。

西安电子科技大学

微电子科学与工程 | 本科

主修课程:

GPA X.XX/X.X(专业前XX%),主修数字集成电路设计、硬件描述语言与计算机体系结构核心课程,完成基于FPGA的图像采集系统课程设计,在项目中负责SDRAM控制器模块的Verilog编码与仿真测试,熟悉VCS仿真工具与Linux开发环境,掌握数字电路前端设计基本流程。

专业背景:具备扎实的数字电路理论基础与项目实践,熟悉芯片数字前端从设计到交付的全流程,掌握Verilog、UVM、Linux等基本技能。技术落地:成功将课程所学应用于实际芯片模块开发,独立完成外设控制器设计并通过验证,保障了项目节点的按时交付。职业素养:工作严谨细致,能快速理解设计需求并执行,具有良好的团队协作意识与文档编写习惯,致力于在项目中持续积累与成长。