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陈小湾
求职意向
工作经历
XXX科技是一家专注于消费电子和物联网领域芯片设计的公司，团队规模约XXX人，核心产品为低功耗AIoT SoC芯片和电源管理芯片，产品已应用于XXX个以上终端品牌，年出货量达XXX万颗，与多家行业方案商建立了稳定的合作关系。
工作概述：
1.物理库评估：根据工艺要求和项目目标，评估不同厂商提供的标准单元库和IO库的性能与面积；通过脚本分析lib文件的时序、功耗和噪声特性，制作对比表格供项目决策，为后端流程选定基础库，确保库选择支撑频率目标并节约芯片面积XXX%。
2.布局规划：负责模块级和芯片顶层的布局规划工作，使用工具完成模块形状定义和摆放；考虑模块间的数据流和时钟域关系，规划电源网络和宏单元的预放置区域，通过多次迭代优化布局拥塞，将初始布局的拥塞度降低XXX%。
3.时钟树综合：制定芯片级和模块级的时钟树综合策略，确定时钟根节点和平衡路径；配置工具参数进行时钟树构建，插入缓冲器并进行时钟偏移和延迟的优化，确保时钟信号满足时序要求，最终时钟偏差控制在XXX皮秒以内。
4.电源网络设计：设计芯片的全局和局部电源网络结构，规划电源环、电源带和电源轨的布线宽度与密度；进行静态和动态IR-drop分析，识别电压降风险区域并添加电源触点或调整布线，将最差情况下的IR-drop值改善XXX%。
5.布线优化：执行芯片的全局布线和详细布线，解决布线过程中的短路、开路和天线效应违规；针对高负载、长距离的关键路径进行布线调整和缓冲区插入，优化信号完整性，将布线后的总负时序余量改善XXX%。
6.签核验证：负责物理验证和时序签核，运行DRC、LVS检查并分析报告中的违规项，协同版图工程师进行修复；执行寄生参数提取并用于最终的时序分析，确保芯片在多种工艺角下均能满足频率和功耗目标，保障芯片成功流片。
工作业绩：
1.参与完成X颗芯片从网表到GDSII的后端物理实现任务，所有项目均成功流片并回片验证。
2.通过布局和布线优化，平均将芯片最终面积较初始预估缩小XXX%，直接降低单个芯片成本。
3.在时钟树综合中稳定控制偏差，支撑主芯片频率达到XXXMHz的设计目标。
4.主导电源网络设计，确保芯片在典型工作场景下IR-drop均低于XXXmV，保障了电路可靠性。
5.通过签核验证流程发现并协助修复XXX个潜在物理和时序风险点，提升流片成功率。
6.建立个人工作检查清单，将日常操作失误率降低XXX%，提升了任务交付的稳定性。
主动离职，希望有更多的工作挑战和涨薪机会。
项目经历
公司面向智能摄像头和门锁产品线研发的关键芯片项目，采用XXX纳米工艺，集成自研的NPU核与多个外设接口。项目挑战在于同时满足低功耗、小面积和高算力的需求，顶层集成阶段面临模块间时序路径复杂、电源网络规划难度大以及物理验证收敛周期紧的问题。
项目职责：
1.模块实现：负责其中两个核心数字模块（图像预处理和系统控制）的后端物理实现，完成从布局规划、时钟树综合到布线和物理验证的全流程。
2.功耗优化：在实现中采用多电压域设计和时钟门控技术，针对模块的睡眠和工作模式分别优化电源开关策略，降低静态和动态功耗。
3.顶层集成支持：协助完成芯片顶层的模块拼接和电源网络一致性检查，负责处理指定模块在顶层环境下的时序接口和物理连接。
4.验证与交付：执行负责模块的DRC/LVS物理验证和时序签核，提取并交付最终的时序模型和物理版图数据供顶层使用。
项目业绩：
1.负责的两个模块均一次通过所有物理验证和时序签核，交付周期比计划提前XXX天。
2.通过后端优化，使负责模块在目标频率下的功耗较预估降低XXX%，助力整芯片达成低功耗指标。
3.模块集成至顶层后接口时序完全闭合，未引入新的顶层违规，支撑芯片最终频率达到XXXMHz。
4.项目实现芯片面积符合预算，成功流片并量产，已应用于XXX万台终端设备。
教育背景
GPA X.XX/X.X（专业前XX%），主修数字集成电路设计、半导体物理等核心课程，熟练掌握Linux操作环境和Tcl/Perl脚本编写。课程设计完成一个基于Synopsys工具链的简易RISC-V处理器后端物理实现流程，负责布局布线环节，实现频率XXXMHz。
自我评价
培训经历
系统学习了数字后端设计全流程方法论，涵盖先进工艺下的物理实现挑战与解决方案。将培训所学的低功耗设计技巧应用于AIoT芯片项目，通过优化时钟门控和电源开关方案，助力模块功耗降低XXX%。总结的时序收敛检查点被纳入小组工作流程。
初级数字后端工程师新颖简历模板
638人使用适用人群: #数字后端工程师 #初级[1-3年]
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[基本信息]
姓名：陈小湾
性别：男
年龄：26
学历：本科
婚姻：未婚
年限：4年
面貌：党员
邮箱：xiaowan@gangwan.com
电话：18600001654
[求职意向]
工作性质：全职
应聘职位：数字后端工程师
期望城市：北京
期望薪资：8000-10000
求职状态：离职-随时到岗
[工作经历]
北京XX科技有限公司 | 数字后端工程师
2024-09 - 2025-12
XXX科技是一家专注于消费电子和物联网领域芯片设计的公司，团队规模约XXX人，核心产品为低功耗AIoT SoC芯片和电源管理芯片，产品已应用于XXX个以上终端品牌，年出货量达XXX万颗，与多家行业方案商建立了稳定的合作关系。
工作概述：
1.物理库评估：根据工艺要求和项目目标，评估不同厂商提供的标准单元库和IO库的性能与面积；通过脚本分析lib文件的时序、功耗和噪声特性，制作对比表格供项目决策，为后端流程选定基础库，确保库选择支撑频率目标并节约芯片面积XXX%。
2.布局规划：负责模块级和芯片顶层的布局规划工作，使用工具完成模块形状定义和摆放；考虑模块间的数据流和时钟域关系，规划电源网络和宏单元的预放置区域，通过多次迭代优化布局拥塞，将初始布局的拥塞度降低XXX%。
3.时钟树综合：制定芯片级和模块级的时钟树综合策略，确定时钟根节点和平衡路径；配置工具参数进行时钟树构建，插入缓冲器并进行时钟偏移和延迟的优化，确保时钟信号满足时序要求，最终时钟偏差控制在XXX皮秒以内。
4.电源网络设计：设计芯片的全局和局部电源网络结构，规划电源环、电源带和电源轨的布线宽度与密度；进行静态和动态IR-drop分析，识别电压降风险区域并添加电源触点或调整布线，将最差情况下的IR-drop值改善XXX%。
5.布线优化：执行芯片的全局布线和详细布线，解决布线过程中的短路、开路和天线效应违规；针对高负载、长距离的关键路径进行布线调整和缓冲区插入，优化信号完整性，将布线后的总负时序余量改善XXX%。
6.签核验证：负责物理验证和时序签核，运行DRC、LVS检查并分析报告中的违规项，协同版图工程师进行修复；执行寄生参数提取并用于最终的时序分析，确保芯片在多种工艺角下均能满足频率和功耗目标，保障芯片成功流片。
工作业绩：
1.参与完成X颗芯片从网表到GDSII的后端物理实现任务，所有项目均成功流片并回片验证。
2.通过布局和布线优化，平均将芯片最终面积较初始预估缩小XXX%，直接降低单个芯片成本。
3.在时钟树综合中稳定控制偏差，支撑主芯片频率达到XXXMHz的设计目标。
4.主导电源网络设计，确保芯片在典型工作场景下IR-drop均低于XXXmV，保障了电路可靠性。
5.通过签核验证流程发现并协助修复XXX个潜在物理和时序风险点，提升流片成功率。
6.建立个人工作检查清单，将日常操作失误率降低XXX%，提升了任务交付的稳定性。
[项目经历]
项目名称：低功耗边缘AI视觉处理芯片后端设计
担任角色：项目负责人
公司面向智能摄像头和门锁产品线研发的关键芯片项目，采用XXX纳米工艺，集成自研的NPU核与多个外设接口。项目挑战在于同时满足低功耗、小面积和高算力的需求，顶层集成阶段面临模块间时序路径复杂、电源网络规划难度大以及物理验证收敛周期紧的问题。
项目业绩：
1.负责的两个模块均一次通过所有物理验证和时序签核，交付周期比计划提前XXX天。
2.通过后端优化，使负责模块在目标频率下的功耗较预估降低XXX%，助力整芯片达成低功耗指标。
3.模块集成至顶层后接口时序完全闭合，未引入新的顶层违规，支撑芯片最终频率达到XXXMHz。
4.项目实现芯片面积符合预算，成功流片并量产，已应用于XXX万台终端设备。
[教育背景]
杭州电子科技大学
微电子科学与工程 | 本科
GPA X.XX/X.X（专业前XX%），主修数字集成电路设计、半导体物理等核心课程，熟练掌握Linux操作环境和Tcl/Perl脚本编写。课程设计完成一个基于Synopsys工具链的简易RISC-V处理器后端物理实现流程，负责布局布线环节，实现频率XXXMHz。